應屆畢業(yè)生
學歷不限
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職位描述
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崗位職責:主要職責：1、 完成新產(chǎn)品設計，包括verilog代碼編寫，仿真驗證，支持FPGA功能驗證；2、 數(shù)字電路的綜合，時序驗證，版圖布局布線后的時序分析，一致性檢查等；3、 生成測試矢量，協(xié)助測試工程師完成調(diào)試；4、 完成新產(chǎn)品的silicon validation和debug相關工作直至量產(chǎn)；5、 完成新產(chǎn)品開發(fā)過程中的文檔工作等 。 任職資格:1、 電子工程、微電子、通信、自動化等相關專業(yè)，碩士及以上學歷；2、 3年以上數(shù)字電路設計經(jīng)驗，具有扎實的數(shù)字電路理論基礎，熟悉代碼、驗證、綜合等ASIC設計流程；3、 具有產(chǎn)品開發(fā)經(jīng)驗者或具有ADC/DAC芯片開發(fā)經(jīng)驗者優(yōu)先；4、 具有基本英語聽說讀寫能力，有較強的學習能力和團隊協(xié)作精神 。
年齡要求：25-40歲
職能類別：數(shù)字前端工程師
關鍵字：熟悉ASIC流程產(chǎn)品開發(fā)經(jīng)驗ADC/DAC開發(fā)
注：聯(lián)系我時，請說是在江蘇人才網(wǎng)上看到的。
工作地點
地址：上海上海
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職位發(fā)布者
HR
上海貝嶺股份有限公司
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電子技術·半導體·集成電路
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1000人以上
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股份制企業(yè)
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宜山路810號
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