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職責描述： 1. 與產(chǎn)品/架構(gòu)團隊合作，結(jié)合業(yè)務需求，理解SoC 架構(gòu)和特性定義； 2. 承擔SoC級的頂層集成、signoff、交付； 3. 承擔SoC級的時鐘、功耗、IO架構(gòu)設計，SDC、UPF實現(xiàn)、交付； 4. 承擔SoC級的測試規(guī)范定義、實現(xiàn)、交付，協(xié)助運營完成量產(chǎn)測試； 5. 協(xié)助中后端進行SoC的物理實現(xiàn)和signoff； 6. 協(xié)助驗證團隊進行SoC級的驗證。 任職要求： 1. 有扎實的數(shù)字電路設計基礎，熟悉verilog語言； 2. 2年以上數(shù)字電路設計工作經(jīng)驗，熟悉數(shù)字電路設計流程； 3. 有團隊合作精神，吃苦耐勞的品質(zhì)，積極上進； 4. 具備SoC設計集成經(jīng)驗，熟悉時鐘、功耗、IO電路設計，理解SDC，UPF者優(yōu)先考慮； 5. 具有CPU及AMBA等總線設計經(jīng)驗者優(yōu)先考慮。