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FPGA信號(hào)處理工程師
25000-35000元 成都 應(yīng)屆畢業(yè)生 本科
  • 全勤獎(jiǎng)
  • 節(jié)日福利
  • 不加班
  • 周末雙休
職位描述
該職位還未進(jìn)行加V認(rèn)證,請(qǐng)仔細(xì)了解后再進(jìn)行投遞!
崗位職責(zé) 1.負(fù)責(zé)雷達(dá)、通信(LTE/5GNR/微波等)或電子對(duì)抗系統(tǒng)的信號(hào)處理算法研究、優(yōu)化及FPGA工程化實(shí)現(xiàn)。 2.使用Matlab搭建仿真模型,驗(yàn)證算法可行性,并轉(zhuǎn)化為FPGA邏輯代碼。 3.完成FPGA器件選型、邏輯系統(tǒng)架構(gòu)設(shè)計(jì)、代碼編寫(Verilog/VHDL)及模塊集成。 4.負(fù)責(zé)數(shù)字中頻處理(如FIR、FFT、DDC、DUC等)、高速接口(AURORA/PCIe/DDR/SRIO/萬兆網(wǎng))驅(qū)動(dòng)開發(fā)及調(diào)試。 5.使用Vivado、ISE、ModelSim等工具進(jìn)行時(shí)序分析、功能仿真及板級(jí)調(diào)試,優(yōu)化系統(tǒng)性能。 6.配合硬件工程師完成電路測(cè)試,使用示波器、頻譜儀等設(shè)備定位并解決信號(hào)完整性問題。 7.編寫設(shè)計(jì)文檔、測(cè)試報(bào)告及技術(shù)方案,管理代碼和文檔版本。 8.參與產(chǎn)品聯(lián)調(diào)與試驗(yàn)驗(yàn)證,協(xié)助解決生產(chǎn)及售后中的技術(shù)問題。 9.跟蹤FPGA技術(shù)趨勢(shì),研究新型器件(如Xilinx/Intel系列)及開發(fā)方法,推動(dòng)技術(shù)迭代。 任職資格 1.電子信息工程、通信工程、雷達(dá)探測(cè)、微電子等相關(guān)專業(yè),本科及以上學(xué)歷。 2.8年以上經(jīng)驗(yàn)(碩士為5年),具備雷達(dá)、通信系統(tǒng)或大型FPGA項(xiàng)目開發(fā)經(jīng)驗(yàn)優(yōu)先。 3.精通Verilog/VHDL語言,掌握FPGA開發(fā)全流程(設(shè)計(jì)-仿真-調(diào)試)。 4.熟悉Xilinx/Intel FPGA架構(gòu)及工具鏈(Vivado、Quartus、ModelSim)。 5.扎實(shí)的數(shù)字信號(hào)處理基礎(chǔ),熟悉數(shù)字濾波、DBF、脈壓、CFAR、調(diào)制解調(diào)、抗干擾、測(cè)角測(cè)向等算法者優(yōu)先。 6.熟練使用Matlab/Simulink進(jìn)行算法仿真。 7.掌握示波器、頻譜儀等測(cè)試儀器操作。
聯(lián)系方式
注:聯(lián)系我時(shí),請(qǐng)說是在江蘇人才網(wǎng)上看到的。
工作地點(diǎn)
地址:成都青羊區(qū)成都-青羊區(qū)青羊總部經(jīng)濟(jì)基地二期
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詳細(xì)位置,可以參考上方地址信息
求職提示:用人單位發(fā)布虛假招聘信息,或以任何名義向求職者收取財(cái)物(如體檢費(fèi)、置裝費(fèi)、押金、服裝費(fèi)、培訓(xùn)費(fèi)、身份證、畢業(yè)證等),均涉嫌違法,請(qǐng)求職者務(wù)必提高警惕。
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